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VHDL语言与计算机C语言的没有差别。

题目

VHDL语言与计算机C语言的没有差别。

相似考题

1.在VHDL语言编写的程序中,注释使用( )符号。A.//B.–C.;D.__

2.VHDL的代码风格类似于C语言。()此题为判断题(对，错)。

3.IEEE 标准的硬件描述语言是 （）和 VHDL。

4.常用的硬件描述语言有()A.VHDL、Verilog、c语言B.ABEL、c++C.VHDL、Verilog、ABELD.汇编语言、ABEL、VHDL

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  • 第1题：

    简述VHDL语言与计算机语言的差别。


    正确答案: 运行的基础
    –计算机语言是在CPU＋RAM构建的平台上运行
    –VHDL设计的结果是由具体的逻辑、触发器组成的数字电路
    执行方式
    –计算机语言基本上以串行的方式执行
    –VHDL在总体上是以并行方式工作
    验证方式
    –计算机语言主要关注于变量值的变化
    –VHDL要实现严格的时序逻辑关系

  • 第2题：

    VHDL语言构造体的描述方式有哪几种？试述各自的特点。


    正确答案: 1，行为描述：采用进程语句，顺序描述被称为设计实体的行为，
    2，数据流描述（寄存器传输描述）：采用进程语句。顺序描述数据流在控制流作用下被加工处理，存储的全过程

  • 第3题：

    计算机硬件不能直接识别和运行的有（）程序。

    • A、 机器语言
    • B、 汇编语言
    • C、 高级语言
    • D、 VHDL

    正确答案:B,C,D

  • 第4题：

    计算机硬件能直接识别和运行的只能是（）程序。

    • A、机器语言
    • B、汇编语言
    • C、高级语言
    • D、VHDL

    正确答案:A

  • 第5题：

    试比较C语言和VHDL语言的区别。


    正确答案:VHDL是硬件描述语言，主要用于描述数字系统的结构、行为、功能和接口，用来组建硬件内部结构连接的。
    C语言是软件语言，主要用于控制CPU进行各种运算。
    前者是并行的，后者是顺序执行的。
    VHDL编译后生成的网表文件写入FPGA后，会改变FPGA内部实际电路硬件连接结构。
    C语言编译后生成的可执行文件写入存储器中，能指定CPU进行的具体操作，但是不会对CPU内部硬件电路连接结构造成变化（假设C语言编写的程序在通用计算机或嵌入式MCU上运行，VHDL描述的电路最终映射到FPGA）。

  • 第6题：

    硬件描述语言的两种主要标准是（）

    • A、VHDL和Verilog HDL
    • B、VHDL和AHDL
    • C、AHDL和Verilog HDL
    • D、Verilog HDL和MHDL

    正确答案:A

  • 第7题：

    在VHDL语言中，信号赋值语句使用的代入符是（）

    • A、=
    • B、：=
    • C、＜=
    • D、==

    正确答案:C

  • 第8题：

    在VHDL语言的LOOP语句中，包含（）循环变量语句和（）条件循环语句。


    正确答案:FOR；WHILE

  • 第9题：

    单选题
    VHDL是（）
    A

     硬件描述语言

    B

     软件描述语言

    C

     构件描述语言

    D

     软件开发工具


    正确答案： D
    解析： 暂无解析

  • 第10题：

    判断题
    VHDL语言与计算机C语言的没有差别。
    A

    对

    B

    错


    正确答案： 对
    解析： 暂无解析

  • 第11题：

    问答题
    简述VHDL语言的用途及其电路描述风格？

    正确答案： VHDL语言的用途
    （1）对IC设计，支持从系统级到门和器件级的电路描述，并具有在不同设计层次上的模拟验证机制；
    （2）可作为综合软件的输入语言，支持电路描述由高层向低层的转换VHDL描述电路的风格。
    结构体对电路描述的方式：
    结构描述：描述电路由哪些模块、如何连接构成的；
    数据流描述：使用VHDL内建的运算符描述电路的输入输出关系；
    行为描述：使用进程语句，描述电路的行为或者算法。
    解析： 暂无解析

  • 第12题：

    问答题
    什么是硬件描述语言？与其它HDL语言相比，用VHDL语言设计电子线路有什么优点？

    正确答案： 可以描述硬件电路的功能，信号连接关系及定时关系的一种语言，称为硬件描述语言。
    和其它HDL语言相比，VHDL语言的优点如下：
    1.易于共享和交流。易于将VHDL代码在不向的工作平台（如工作站和PC机）和开发工具之间交换。
    2.设计结果与工艺无关。设计者可以专心致力于其功能，即需求规范的实现，而不需要对不影响功能的与工艺有关的因素花费过多的时间和精力。
    3.设计方法灵活、支持广泛。VHDL语言可以支持自上而下（TopDown）和基于库（Library-Based）的设计方法，支持同步电路、异步电路、FPGA以及其它随机电路的设计。
    4.系统硬件描述能力强。VHDL语言具有多层次描述系统硬件功能的能力，可以从系统的数学模型直至门级电路。另外，高层次的行为描述可以与低层次的RTL描述和结构描述混合使用。
    解析： 暂无解析

  • 第13题：

    VHDL语言数据对象有哪几种？


    正确答案:VHDL语言数据对象有信号，变量，常量。

  • 第14题：

    简述VHDL语言的主要优点。


    正确答案:VHDL语言的主要优点是：（1）覆盖面广，描述能力强，是一个多层次的硬件描述语言；（2）可读性好，既能够被计算机接受，也容易被人理解；（3）生命期长，它的硬件描述与工艺技术无关，不会因工艺变化而过时；（4）支持大规模设计的分解和已有设计再利用，有利于由多人或多项目组来共同完成一个大规模设计；（5）已成为IEEE承认的一个工业标准，成为一种通用的硬件描述语言。

  • 第15题：

    VHDL是（）

    • A、 硬件描述语言
    • B、 软件描述语言
    • C、 构件描述语言
    • D、 软件开发工具

    正确答案:A

  • 第16题：

    编写计算机程序所用的计算机语言称为（）语言。它是人与计算机之间交换信息的工具，分为（）语言、（）语言和（）语言三类。


    正确答案:程序设计；机器；汇编；高级

  • 第17题：

    在VHDL语言中的数据主要包括以下3种：（）、（）、（）。


    正确答案:信号；变量；常数

  • 第18题：

    一个完整的VHDL语言程序通常包括：（）、（）、（）、（）、（）5部分。


    正确答案:实体；构造体；配置；包集合；库

  • 第19题：

    在VHDL语言中，变量的赋值符是（）。

    • A、=
    • B、：=
    • C、＜=
    • D、==

    正确答案:B

  • 第20题：

    问答题
    VHDL语言数据对象有哪几种？

    正确答案： VHDL语言数据对象有信号，变量，常量。
    解析： 暂无解析

  • 第21题：

    问答题
    简述VHDL语言与计算机语言的差别。

    正确答案： 运行的基础
    –计算机语言是在CPU＋RAM构建的平台上运行
    –VHDL设计的结果是由具体的逻辑、触发器组成的数字电路
    执行方式
    –计算机语言基本上以串行的方式执行
    –VHDL在总体上是以并行方式工作
    验证方式
    –计算机语言主要关注于变量值的变化
    –VHDL要实现严格的时序逻辑关系
    解析： 暂无解析

  • 第22题：

    问答题
    简述VHDL语言的主要优点。

    正确答案： VHDL语言的主要优点是：（1）覆盖面广，描述能力强，是一个多层次的硬件描述语言；（2）可读性好，既能够被计算机接受，也容易被人理解；（3）生命期长，它的硬件描述与工艺技术无关，不会因工艺变化而过时；（4）支持大规模设计的分解和已有设计再利用，有利于由多人或多项目组来共同完成一个大规模设计；（5）已成为IEEE承认的一个工业标准，成为一种通用的硬件描述语言。
    解析： 暂无解析

  • 第23题：

    问答题
    VHDL语言的变量和信号有什么区别？

    正确答案： 1，信号赋值是有一定延迟的，而变量赋值是没有延迟的，
    2，对于进程语句来说，进程只对信号敏感，而不对变量敏感
    3，信号在莫一时刻除了具有当前值外，还有一定的历史信息，而变量在某一时刻只包含一个值，
    4，信号可以是多进程的的全局信号，而变量只在定义它的过程，函数，和进程中可见，
    5，信号时硬件中连线的抽象描述，其功能是保存变化的数据值和连接子元件，信号在元件的端口连接元件，变量在硬件中没有类似的对应关系，主要应用于高层次的建模中。
    解析： 暂无解析

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