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高速缓冲存储器Cache是位于CPU和主存DRAM之间规模或容量较小但速度很快的存储器。下面是关于Cache的叙述，其中错误的是( )。A．PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即，达到了即降低成本又提高系统性能的目的B．CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态C．CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态D．L1 Cach
题目
高速缓冲存储器Cache是位于CPU和主存DRAM之间规模或容量较小但速度很快的存储器。下面是关于Cache的叙述，其中错误的是( )。
A．PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即，达到了即降低成本又提高系统性能的目的
B．CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态
C．CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态
D．L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率
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参考答案和解析
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第1题：
关于Cache(高速缓冲存储器)的说法中，错误的是(9)。
A．在体系结构上，Cache存储器位于主存与CPU之间
B．Cache存储器存储的内容是主存部分内容的拷贝
C．使用Cache存储器并不能扩大主存的容量
D．Cache的命中率只与其容量相关
正确答案：D
解析：本题考查高速缓存基础知识。高速缓存Cache有如下特点：它位于CPU和主存之间，由硬件实现；容量小，一般在几KB到几MB之间；速度一般比主存快5到10倍，由快速半导体存储器制成；其内容是主存内容的副本，对程序员来说是透明的；Cache既可存放程序又可存放数据。Cache存储器用来存放主存的部分拷贝(副本)。控制部分的功能是：判断CPU要访问的信息是否在Cache存储器中，若在即为命中，若不在则没有命中。命中时直接对 Cache存储器寻址。未命中时，若是读取操作，则从主存中读取数据，并按照确定的替换原则把该数据写入Cache存储器中：若是写入操作，则将数据写入主存即可。Cache的命中率主要与如下几个因素有关：程序在执行过程中的地址流分布情况：当发生Cache块失效时，所采用的替换算法：Cache的容量：在组相联映像方式中，块的大小和分组的数目；所采用的Cache预取算法等。Cache的命中率随它的容量的增加而提高，它们之间的关系曲线见下图所示。在 Cache容量比较小的时候，命中率的提高得非常快，随着Cache容量的增加，命中率提高的速度逐渐降低。当Cache容量增加到无穷大时，命中率可望达到100%，但这实际上是做不到的。
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第2题：
● 以下关于Cache（高速缓冲存储器）的描述， （9） 是错误的。
（9）
A． 在体系结构上，Cache存储器位于主存与CPU 之间
B． Cache存储器存储的内容是主存部分内容的拷贝
C． 使用Cache存储器并不能扩大主存的容量
D． Cache的命中率只与其容量相关
正确答案：D
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第3题：
以下关于Cache (高速缓冲存储器)的叙述中，不正确的是（ ）A.Cache 的设置扩大了主存的容量
B.Cache 的内容是主存部分内容的拷贝
C.Cache 的命中率并不随其容量增大线性地提高
D.Cache 位于主存与 CPU 之间答案：A解析：Cache存储器用来存放主存的部分拷贝（副本）。它是按照程序的局部性原理选取出来的最常使用或不久将来仍将使用的内容。 -
第4题：
● 关于Cache（高速缓冲存储器）的说法中，错误的是（9）
（9）
A. 在体系结构上，Cache存储器位于主存与CPU 之间
B. Cache存储器存储的内容是主存部分内容的拷贝
C. 使用Cache存储器并不能扩大主存的容量
D. Cache的命中率只与其容量相关
正确答案：D
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第5题：
● 下面关于 Cache（高速缓冲存储器）的叙述， “ （9） ”是错误的。
（9）
A. 在体系结构上，Cache 存储器位于主存与 CPU之间
B. Cache 存储器存储的内容是主存部分内容的拷贝
C. 使用 Cache 存储器并不能扩大主存的容量
D. Cache 的命中率只与其容量相关
正确答案：D