A、输入信号及触发器的时钟信号有脉冲用1表示,无脉冲用0表示
B、次态逻辑的输出包括触发器的控制输出和时钟输入
C、两个或两个以上的输入变量不能同时为一;输入全为零时,电路状态不变
D、在设计时,状态变化(即状态由0到1,1到0),令CLK=1
第1题:
同步时序电路和异步时序电路的最主要区别是,前者没有CP脉冲,后者有CP脉冲。()
第2题:
3、异步时序电路的分析方法与异步时序电路分析方法的区别在于()
A.考虑每个触发器的输出方程
B.考虑每个触发器的状态方程
C.考虑每个触发器是否是边沿触发器
D.考虑每个触发器的时钟方程
第3题:
1、异步时序电路的设计与同步时序电路的设计主要区别在于异步时序电路需要设计()。
A.时钟方程
B.状态方程
C.输出方程
D.自启动能力
第4题:
同步时序电路和异步时序电路有何区别?
第5题:
4、异步时序电路设计中必须考虑时钟方程的设计